Francisci, E., & Jelemenská, K. (1999). Návrh a implementácia simulačného systému jazyka VHDL = The design and the implementation of the logical VHDL simulator: Dipl.práca. STU v Bratislave FEI.
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Style de citation Chicago (17e éd.)
Francisci, Erik, et Katarína Jelemenská. Návrh a Implementácia Simulačného Systému Jazyka VHDL = The Design and the Implementation of the Logical VHDL Simulator: Dipl.práca. Bratislava: STU v Bratislave FEI, 1999.
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Style de citation MLA (9e éd.)
Francisci, Erik, et Katarína Jelemenská. Návrh a Implementácia Simulačného Systému Jazyka VHDL = The Design and the Implementation of the Logical VHDL Simulator: Dipl.práca. STU v Bratislave FEI, 1999.
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