Vršanský, J., Weber, B., & Šatka, A. (2003). Implementácia FIR filtra v FPGA. STU v Bratislave FEI.
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Vršanský, Július, Bedřich Weber, and Alexander Šatka. Implementácia FIR Filtra V FPGA. Bratislava: STU v Bratislave FEI, 2003.
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Citação norma MLA
Vršanský, Július, et al. Implementácia FIR Filtra V FPGA. STU v Bratislave FEI, 2003.
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